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1、课程设计报告书课程名称：电子技术综合设计学 院：专 业：班 级：学 号：学生姓名：指导教师：职 称：2022年 月日目录-设计要求1.1 设计要求二方案设计2. 1系统工作原理3. 2 74LS729电路设计四系统电路设计4.1抢答电路设计五程序设计5.1程序设计六仿真验证6.1清零状态仿真6. 2选手开始状态测试6. 3选手抢答状态测试七总结7.1课程设计总结智能抢答器设计摘要抢答器是一种应用非常广泛的设备，在各种竞赛、抢答场合中，它能迅速、 客观地分辨出最先获得发言权的选手。早期的抢答器只由几个三极管、可控硅、 发光管等组成，能通过发光管的指示辩认出选手号码。现在大多数抢答器均使用 单片机
2、或数字集成电路，并增加了许多新功能，如选手号码显示、抢按前或抢按 后的计时、选手得分显示等功能。介绍了数码显示抢答器电路的组成、设计及功能，电路采用74系列常用集 成电路进行设计。该抢答器具有基本的抢答功能，抢答器主要运用到了编码器， 译码器和锁存器：它采用74LS148来实现抢答器的选号，采用74LS279芯片实 现对号码的锁存功能。通过课程设计提高和巩固了所学的专业知识，以及知识的综合应用进行 multisim 仿真。关键词：抢答器；编码；数码管；译码电路1系统设计与分析1.1设计要求1、实际进行智力竞赛时，通常分为若干组，各组对主持人提出的问题，分“必答”和 “抢答”两种。必答有时间限制
3、，到时有告警，回答问题的得分情况由主持人判别并予以显 示。抢答时，对抢答的优先组有声光报警。要实现上述抢答器逻辑功能，具体设计要求如下： (1)竞赛的组数为四组，每组有三位加/减记分显示电路。(2)必答开始时，指示灯亮；时间用完时，音响电路发出一声嘟声(音频约500HZ)。(3)抢答电路输入抢答信号的控制开关应用无抖动开关来实现。抢答电路应能迅速、准确 地判出优先组，对其进行声光报警；同时能封闭其它组的抢答信号，使其它组的抢答信号失 去作用。(4)回答问题的时间可以预置，可置为10秒、20秒、30秒或更长一些。(5)主持人应有复位按钮。2方案设计2. 1系统工作原理电路包括主体电路部分。其中主
4、体电路完成基本的抢答功能，即主持人按下控制开关后，当 选手按动抢答键时，数码管显示选手编号，同时封锁输入电路，其他选手抢答无效。电路的 工作过程是：接通电源后，主持人将控制开关置于“清除”处，此时抢答器处于禁止状态，选 手不能进行抢答，当主持人将控制开关置于“开始”时，抢答器处于工作状态。当选手在定 时时间内按动抢答键时，电路要完成以下功能：（1）优先编码电路判断抢答者的编号，并由锁存器进行锁存，然后通过译码显示电路在数 码管上显示抢答者的编号；2）控制电路对其余输入编码进行封锁，禁止其他选手进行抢答；（3）当选手将问题回答完毕，主持人操作控制开关进行系统清零，使系统回复到禁止工作 状态，以便
5、进行下一轮抢答。如图2.1所示为总体方框图。接通电源后，后台工作人员将检测开关S置“检测”状态，数码 管在正常清除下，显示“8”；当后台工作人员将检测开关S置“抢答”状态，主持按系统清除 按键，抢答器处于禁止状态，编号显示器灭灯；主持人松开，宣布“开始”，抢答器工作。选 手按动抢答按键，抢答器完成：优先判断、编号锁存、编号显示。当一轮抢答之后，优先抢 答选手的编号-直保持到主持人将系统清除为止。如果再次抢答必须由主持人再次按动系统检测按钮抢答按键I I优先编码器I I锁存器I I译码显示器I Q主持人按键清除按键。图2.1总体方框图3模块电路设计3.1 译码电路设计74LS48是用于驱动共阴极
6、LED （数码管）显示器的BCD码一七段码译码器，特点：具 有BCD转换、消隐和锁存控制、七段译码及驱动功能的CMOS电路能提供较大的拉电流。 可直接驱动LED显示器。引脚排列如下图：VCC f g a b C d e6 sl 4l l 2l v ol lLlJ LjJ J L41 151 |_6j UJ LjJB C LT BI/RBO RBI D A GND图3.1 74LS48引脚图其中abed为BCD码输入，a为最低位。Ur为灯测试端，加高电平时， 显示器正常显示，加低电平时，显示器一直显示数码“8”，各笔段都被点亮，以 检查显示器是否有故障。BI为消隐功能端，低电平时使所有笔段均消隐
7、，正常 显示时，Bl端应加高电平。另外CD4511有拒绝伪码的特点，当输入数据越过 十进制数9（1001）时，显示字形也自行消隐。LE是锁存控制端，高电平时锁存, 低电平时传输数据。ag是7段输出，可驱动共阴LED数码管。另外，CD4511 显示数“6”时，a段消隐；显示数“9”时，d段消隐，所以显示6、9这两个数时, 字形不太美观。输出端（YaYg）为高电平有效，可驱动灯缓冲器或共阴极VLED。当要求输出015时，消隐输入（瓦）应为高电平或开路，对于输出为 0时还要求脉冲消隐输入（而7）为高电平或者开路。当3/为低电平时，不管其它输入端状态如何，YaYg均为低电平。当RBl和地址端（A0-A
8、3）均为低电平，并且灯测试输入端（万）为高 电平时，Ya Yg为低电平，脉冲消隐输出（而5）也变为低电平。当BI为高电平或开路时，LT为低电平可使Ya-Yg均为高电平。48与248的引出端排列、功能和电特性均相同，差别仅在显示6和9,248所显示的6和9比48多出上杠和下杠。引出端符号AO-A3译码地址输入端3/RBO消隐输入（低电平有效）/脉冲消隐输出（低电平有效）LT灯测试输入端（低电平有效）R3/脉冲消隐输入端（低电平有效）3.2 74LS279电路设计触发器是数字电路中的一种基本单元，它与门电路配合，能构成各种各样的时序逻辑部件， 如记数器、寄存器、序列信号发生器等。一个触发器具有如下
9、的特点：两个互补的输出端Q和Q；和“1”两个稳态；触发器翻转的特性；记忆能力。1 .对触发器的基本要求1）应该具有两个稳定状态0状态和1状态2）能够接收、保存和输出信号2 .触发器的现态和次态现态一触发器接收输入信号之前的状态叫做现态，用Qn表示。次态触发器接收输入信号之后的状态叫做次态，用Qn+1表示。3 .触发器的分类1）按照电路结构和工作特点分基本触发器、同步触发器、主从触发器和边沿触发器2）按照（在时钟控制下的）功能分RS型触发器、D触发器、JK触发器、T触发器和触发器4 .时序逻辑电路组合逻辑电路的特点是电路的输出仅取决于当时的输入，与电路的历史状态无关。即Z=F（X）. 时序逻辑电
10、路的输出状态不仅与该时刻的输入有关，而且还与电路的历史状态有关。由现在的输入状态和现在的输出状态共同决定下一次的输出状态。电路特点输入、输出之间至少有一条反馈路径；电路中含有贮存单元。Q为触发器的输出，称为状态变量。Qn表示现态，Qn+1表示次态；状态 是时序电路的一个重要概念。W为触发器的输入，也是时序电路的控制变量；CP为时钟脉冲。5.描述时序电路逻辑功能的方法(1)方程式：输出方程：Z=Fl (X, Qn)驱动方程：W=F2 (X, Qn)状态方程：Qn+1=F3 (W, Qn)(2)状态表反映输入、输出、现态、次态之间的关系的表格。(3)状态图反映时序逻辑电路的状态转换规律及相应输入出
11、取值情况的几何图形。(4)时序图表示各信号，电路状态等的取值在时间上的对应关系。构成时序逻辑电路常用存储单元是触发器。741s279是RS触发器，RS触发器分三种：基本rs触发器、同步rs触发器、 主从rs触发器。741s279是四个基本rs触发器，输入的是r非、S非，而不是rs。 所以：当r非端输入1, s非端输入0,则Q为1。当r非端输入0, s非端输入1,则Q为0。当r非端输入1, s非端输入1,则Q为保持。管脚和逻辑功能图图3.2 74LS279引脚图4.系统电路设计4.1 抢答电路设计此部分电路主要完成的功能是实现4路选手抢答并进行锁存，同时有相应发 光二极管点亮和数码显示。使用优先
12、编码器74LS148和锁存器74LS297来完成。该电路主要完成两 个功能：一是分辨出选手按键的先后，并锁存优先抢答者的编号，同时译码显示 电路显示编号（显示电路采用七段数字数码显示管）；二是禁止其他选手按键， 其按键操作无效。工作过程：开关S置于”清除端时，RS触发器的R、S端均 为0, 4个触发器输出置0,使74LS148的优先编码工作标志端=0,使之处于 工作状态。当开关S置于“开始”时，抢答器处于等待工作状态，当有选手将抢 答按键按下时（如按下S5）, 74LS148的输出经RS锁存后，CTR=LRBO =1,七 段显示电路74LS48处于工作状态，4Q3Q2Q=011,经译码显示为“
13、3”。此外，CTR =1,使74LS148优先编码工作标志端=1 ,处于禁止状态，封锁其他按键的输 入。当按键松开即按下时，74LS148的此时由于仍为CTR=I,使优先编码工 作标志端=1,所以74LS148仍处于禁止状态，确保不会出二次按键时输入信号， 保证了抢答者的优先性。只要有一组选手先按下抢答器，就会将编码器锁死，不 再对其他组进行编码。通过74LS48译码器使抢答组别数字显示l-4o如有再次 抢答需由主持人将S开关重新置“清除”然后再进行下一轮抢答。其工作原理是：当主持人控制开关处于“清零”位置时，RS触发器的R端为 低电平，输出端（4QIQ）全部为低电平。于是74LS48的BI=
14、O,显示器灭灯； 74LS148的选通输入端ST=O, 74LS148处于工作状态，此时锁存电路不工作。 当主持人将开关拨到“开始”位置时;优先编码电路和锁存电路同时处于工作状态, 既抢答器处于等待工作状态，等待输入端17、16、15、14、13、12、II、10输入 信号，当有选手将键按下时（如按下S5）,74LS148的输出Y2YlY0=010,YEX=0, 经RS锁存器后，CTR=L BI=I,此时74LS279处于工作状态，4Q3Q2Q=101, 经74LS48译码后，显示器显示出“5: 此外，CTR=I,使74LS148的ST端为高 电平,74LS148处于禁止工作状态,封锁了其它按
15、键的输入。当按下的键松开后， 74LS148的YEX高电平，但由于CTR维持高电平不变，所以74LS148仍处于禁 止工作状态，其它按键的输入信号仍不会被接受。这就保证了抢答者的优先性以 及抢答电路的准确性。当优先抢答者回答完问题后，主持人操作控制开关S,使 抢答电路复位，以便进行下一轮抢答。5程序设计使用741sl92芯片制作减法器的方法，所以通过学习对这个芯片的使用，制 作一个六十进制的减法计数器，以达到计时的目的。实际工作中，考虑到六十进 制可由一个六进制部分的十位电路与个十进制的各位电路来构成，所以，选材 时直接选用十进制的计数器SN741sl92芯片。以下为该芯片模拟图与各管脚功能
16、介绍：ccALRBoxc,AIrCD V C OL N bqbqadopqcq)gn74192图5.174LS192引脚图管脚说明：A、B、C、D各管脚为芯片的输入端，置数功能时使用；QA、QB、QC、QD各管脚为芯片的输出端，输出为842IBCD码，QA对 应最低位，QD为最高位；DOWN、UP管脚为功能选择端。当De)WN输入时钟脉冲信号时，UP输入 “1”，芯片以信号时钟时间为周期做常规减法计算，即减1法，UP输入为“0”时， 做减2法计算；当UP输入时钟脉冲时，DOWN输入力”，芯片做加法运算；BO Cer两端口分别对应借位输出和进位输出，LoAD，端口为置数端；CLR端口为清零端。功
17、能表如下：表5-1741sl92的功能表输入输出CLRUPDOWNLOAD,DCBAQDQCQBQA1XXXXXXX00000XX0clCbadCba0CP1XXXX加法计数0CP1XXXX减法计数有了借位与保持功能后，将借位输出信号作为时钟脉冲信号，控制十位上的 计数功能，以实现六十进制的同步计数器。到此，六十进制的减法计数器设计思想已经完善，通过组合，即可实现，要 实现计时器的功能，只需将脉冲信号的频率设置为1赫兹即可，此时脉冲周期为 一秒。下图是计时器的设计图：图5.倒计时电路设计6仿真调试6.1清零状态仿真图6.1系统清零状态6.2抢答开始状态测试图6.2系统抢答开始状态6.3选手抢答
18、状态测试图6.3选手抢答状态7课程设计总结这次设计，从接到老师给我们的任务后，就认真找资料，资料很多，网上更 是繁杂。很快就找到了自己要做的东西，于是马上multisim仿真，这一步就是关 键了，经过一个星期的反复修改，才终于弄好。通过这次设计，我对数字电路设 计中的逻辑关系有了更深入的了解，在设计的过程中，虽然遇到了很多的问题， 有一些知识也不太明白，但通过一些资料又重新去了解数字电路部分的内容。在 这次课程设计中，我全身心投入，时间感觉过的很快，虽然实物设计不怎么成功, 但付出了汗水，也得到了一定的收获，我体会到了在创造过程中探索的艰难和小 小成功的喜悦，培养了我们独立思考和动手的能力，树
19、立了自己对今后工作能力 的信心。在此,感谢老师给我这个锻炼的机会,感谢你们教会了我一定的技能和知识, 请相信我们将会做得更好！在实验制作中，我体会到制作的过程是先苦后甜的，只有潜下心来用心去做。 体会到了乐趣，就更愿意自己动手去做东西，这应该就是这门专业的意义！参考文献I张建华.数字电子技术M.北京：机械工业出版社,2000.2郭锁利.基于Multisim9的电子系统设计仿真与综合应用M.北京：人民邮电出版 社,2008.3|姚福安.电子电路设计与实践M.济南：山东科技大学出版社，2001.4刘南平，李擎.数字电子技术M.北京：科学出版社，2005.5童诗白，徐振英.现代电子学及应用M.北京：
20、高等教育出版社，1994.6孙梅生，李美莺，徐振英.电子技术基础课程设计M.北京：高等教育出版社,2004.7梁宗善.电子技术基础课程设计M.武汉：华中理工大学出版社.2003.8张玉璞，李庆常.电子技术课程设计M.北京：北京理工大学出版社.2000.9彭介华.电子技术课程设计指导M.北京：高等教育出版社,2001.10童师白,华成英.模拟电子技术基础,第三版.北京:高等教育版社,2001.111阎石.数字电子技术基础,第四版.北京:高等教育版社,1998.12吕思忠，数子电路实验与课程设计哈尔滨工业大学出版社.13郑家龙，集成电子技术基础教程高等教育出版社.14高吉祥电子技术基础实验与课程设计电子工业出版社.
