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1、- Costas 环研究总结报告1、 研究目的：高速移动通信系统中，收、发送机的相对运动使得接收信号不可防止地形成快衰落信道，从而引入较大的多普勒偏移和多普勒变化率，故此必须纠正或补偿多普勒频偏和多普勒变化率，以保证收发系统间的信号同步。由于较大的多普勒频偏和多普勒变化率的存在，造成接收载波与给定载波在频率和相位上均存在较大的差异，为正确解调需使用载波跟踪机制来提取相干载波，costas环路是高效、可靠的跟踪环路，在成熟系统中常用来来提取接收信号相干载波，以实现对接收信号进展准确相干解调，确保收发系统信号间高可靠和高精度的同步。二、性能要求：依系统指标需求，要求该环路能够狗在100 us约合2
2、00个复值信号点之到达求解稳定，输出相干载波的实时频偏估测值，并纠正频偏，纠偏围依系统指标需求应到达1khz-30khz载波2Mhz；频率抖动围在频偏的10%以噪声10db；相位抖动围在5o噪声10db。基于costas环路的高效性和可靠性以及较低的实现代价，本课题经过仿真验证，选择该环路作为该功能模块的实现环路。三、costas环路根本原理概述： Costas环路在系统架构中的接入示意图如图1所示：图1 costas环路系统架构中的接入图 Costas环路功能构造图如图2所示：图2 costas环路功能构造图设输入的下变频后的2PSK信号假设没有GAWN噪声影响，其中m(t)是基带调制信号c
3、os(WCt)是调制载波，假定环路锁定，且不考虑噪声影响，则振荡器输出的两路互为正交的本地载波分别为 (2) (3)为本地载波与输入相干载波之间的相位差。由图1所示输入信号分别与锁定后的本地载波即式(2)、(3)相乘得到 (4) (5)经过低通滤波器滤除2倍分量得到(6) (7)V5和V6相乘得到 (8)可以把上面局部看做是一个鉴相的过程，就是鉴相结果。环路滤波器的功能构造图如图3所示：图3 环路滤波器则经过环路滤波器得到 (10)环路滤波器输出相角，控制VCO的相位和频率，使一直变小直到接近于0，此时锁相环进入稳定状态，此时V1就是所需的相干载波，而V5就是相干解调输出。四、costas环路
4、具体算法实现图4 QPSK信号相干载波提取与相干解调实现下变频后得到两路信号假设在理想状态下点的偏转只和频偏有关忽略噪声的影响 (9)为初相，等于频偏和载波的比值。 VCO输出信号可以表示为 (10)令(9)与(10)相乘 (11) (12) (13)鉴相： 1) 反正切函数法14基于QPSK调制，QPSK调制所有的点都位于，假设想正确解调信号，则解调后的所有点都应位于旋转的坐标轴上。相角为 (15)2) 符号函数法 (16)3) 乘法器+低通滤波器法令已调信号 VCO输出 (17)经过低通滤波器滤除2倍分量得到 (18) 综上所述三种鉴相方法，(2)和(3)都用到(这公式只在很小时成立，所以
5、(1)准确度最高，本研究采用反正切函数法。环路滤波器：环路滤波器对输入信号的噪声起抑制作用，并调节环路的矫正速度。常用的环路滤波器有无源比例积分滤波器，有源比例积分滤波器，理想比例积分滤波器。选择理想比例积分滤波器进展讨论：图3 理想比例积分滤波器 (19)K1和K2是此环路滤波器的两个系数， (20) 为环路增益，是锁相环阻尼系数，为环路固有角频率，是环路噪声带宽，是环路滤波器的采样周期即NCO相位调整时间间隔。根据(20)式计算环路滤波器系数：1) 确定阻尼系数(工程取值一般为0.707)。2) 根据锁相环的跟踪精度要求及跟踪围要求确定其等效噪声带宽通常取为信息数据速率。3) 由量化的阶数
6、及NCO输出的量化幅度值计算环路增益。VCO：用于根据给定的相角产生正弦和余弦三角函数。根据接收信号得到相角，经过环路滤波器后去控制VCO的输出，使得相角逐渐变小，最终使相角减小到很小的数值，得到稳定的可以估计出频率偏移，re和im就是信号的相干解调后的实部和虚部。五、VHDL仿真实现已下变频调制后的QPSK信号I和Q两路，载波2Mhz，噪声10dB，设定环路滤波器系数C1=1/2，c2=1/27。 VHDL各模块端口描述：图4 VHDL构造图顶层模块 PONENT costas_PLL3 PORT( clk200m : IN std_logic; -200M时钟用于高速计算 clk2m :
7、IN std_logic; -2M时钟信号输入时钟 rst : IN std_logic; -复位信号高有效 IM_in : IN std_logic_vector(15 downto 0); -输入信号虚部 RE_in : IN std_logic_vector(15 downto 0); -输入信号实部 chu_enable : IN std_logic; -chu序列有效标志位 data_enable : IN std_logic; -有效数据有效标志位 IM_out : OUT std_logic_vector(15 downto 0);-虚部输出 RE_out : OUT std_l
8、ogic_vector(15 downto 0);-实部输出 chu_v : OUT std_logic; -chu序列标志位 data_v : OUT std_logic; -有效数据标志位 clk_out : OUT std_logic; -输出时钟 ); END PONENT;复乘模块ponent ple* port( clk:in std_logic; -输入200M高速时钟 ar:in std_logic_vector(15 downto 0);-输入数据实部 ai:in std_logic_vector(15 downto 0);-输入数据虚部 br:in std_logic_ve
9、ctor(15 downto 0);-相角余弦输入 bi:in std_logic_vector(15 downto 0);-相角正弦输入 pr:out std_logic_vector(31 downto 0);-输出实部 pi:out std_logic_vector(31 downto 0);end ponent;-输出虚部鉴相模块ponent phase_out port(clk:in std_logic; -输入200M高速时钟 reset:in std_logic; -复位信号 enable:in std_logic; -鉴相使能标志位 *_in:in std_logic_vect
10、or(15 downto 0);-输入复乘器的实部结果 y_in:in std_logic_vector(15 downto 0);-输入复乘器的虚部结果 phase_out:out std_logic_vector(15 downto 0);-相位角输出相位响应输出end ponent;环路滤波器模块ponent loop_filter port(clk:in std_logic; -200M高速工作时钟 reset:in std_logic; -复位信号 count2:in std_logic_vector(15 downto 0); -计数器循环计数周期100 phase_in:in s
11、td_logic_vector(15 downto 0);-输入鉴相器输出的相角角 freq_part1:out std_logic_vector(15 downto 0);-频率响应输出 phase_out1:out std_logic_vector(15 downto 0);-输出一个经环路滤波器平滑后的相位角end ponent;VCO模块ponent cordic -用cordic模块作为VCOport(clk:in std_logic; -200M高速时钟 phase_in:in std_logic_vector(15 downto 0);-环路滤波器输出的相位角 sin:out s
12、td_logic_vector(15 downto 0); -输入的相角的正弦函数输出cosine:out std_logic_vector(15 downto 0);-输入的相位角的余弦函数输出end ponent;仿真结果输出入下列图：进入锁相环的信号星座图如下列图：图5：进入锁相环的信号星座图信号经过锁相环后其频率响应曲线如下列图图6：锁相环频率响应曲线图信号经过锁相环的相位响应曲线如下列图：图7 锁相环相位响应曲线图信号经过锁相环后的星座图如下列图图8：信号经过锁相环后输出的星座图(此星座图是锁相环锁定后估计出平均频偏后逐点纠频所得，由于初相角未知固此星座图有个固定偏移)得出结论：在1
13、30点后锁相环进入锁定状态，估计出频偏大概为6Khz，频偏抖动围是500hz，相位在围抖动，星座聚拢在四个点上，锁相环成功锁定。锁相环的锁定频偏的围可以通过改变程序中的环路滤波器系数来改变，本程序的锁定围大概在800hz-30Khz。锁相环锁定时间和其精度是负相关的，假设要缩短锁定时间必然要牺牲精度，反之亦然。6、 缺点与缺乏及解决方案：缺点与缺乏：锁相环锁定后输出的信号星座图存在的旋转。这种旋转是由于不知道信号经QPSK调制后的相位造成的。解决方案：可以先发一有限长的经QPSk调制后均位于初相的信号，这样可以纠正旋转。可以在锁相环锁定后取频偏的平均值，然后直接根据其频偏的平均值来纠频。这样会存在一个固定相位的旋转即进入锁相环的信号的第一个码元的初相。可以把QPSK调制后的信号进展差分编码，即采用相对移相QDPSK，然后对锁相环输出数据进展差分译码即可。. z.
